Codegenerator zur Erstellung von VHDL-AMS I/O Simulationsmodellen aus IBIS Beschreibungen

Gernot Hueber; Richard Hagelauer

Codegenerator zur Erstellung von VHDL-AMS I/O Simulationsmodellen aus IBIS Beschreibungen

Institute for Integrated Circuits and Quantum Computing

Research output: Chapter in Book/Report/Conference proceeding › Conference proceedings

Abstract

In dieser Arbeit wird ein Codegenerator vorgestellt, der es erlaubt, IBIS I/O Modelle in VHDL-AMS Modelle zu konvertieren und damit direkt in digital bzw. analog/digital Designs einzubinden

Original language	German (Austria)
Title of host publication	Informationstagung Mikroelektronik 2003
Number of pages	609
Publication status	Published - 2003

Fields of science

102005 Computer aided design (CAD)
202 Electrical Engineering, Electronics, Information Engineering
202006 Computer hardware
202018 Semiconductor electronics
202023 Integrated circuits
202027 Mechatronics
202028 Microelectronics
202037 Signal processing

Cite this

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TY - GEN

T1 - Codegenerator zur Erstellung von VHDL-AMS I/O Simulationsmodellen aus IBIS Beschreibungen

AU - Hueber, Gernot

AU - Hagelauer, Richard

PY - 2003

Y1 - 2003

N2 - In dieser Arbeit wird ein Codegenerator vorgestellt, der es erlaubt, IBIS I/O Modelle in VHDL-AMS Modelle zu konvertieren und damit direkt in digital bzw. analog/digital Designs einzubinden

AB - In dieser Arbeit wird ein Codegenerator vorgestellt, der es erlaubt, IBIS I/O Modelle in VHDL-AMS Modelle zu konvertieren und damit direkt in digital bzw. analog/digital Designs einzubinden

M3 - Konferenzbeitrag

BT - Informationstagung Mikroelektronik 2003

ER -